yangshenbo
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UDP_data_process
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Verilog 100%
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yangshenbo c9da7e57f7 以后把设计文档也提交保存，给别人看 2026-01-09 19:49:53 +08:00
readme 以后把设计文档也提交保存，给别人看 2026-01-09 19:49:53 +08:00
UDP_data_process.v 是基本正确的两个verilog文件，是12月12日晚上发给周老师的能用版本，其中data_process存的是供板级用的版本，仿真可能有问题 2026-01-09 19:36:54 +08:00
status_to_udp.v 彻底修复因valid有时拉高有时拉低导致我的模块多发的问题，修复crc会计算包头的BUG 2026-01-09 19:42:43 +08:00