thfu
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TailCorr
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Fork 0
Code Issues Pull Requests Packages Projects Releases Wiki Activity
拖尾矫正
20 Commits 4 Branches 0 Tags 22 MiB
Verilog 80.7%
SystemVerilog 13%
MATLAB 3.5%
Coq 1.2%
Makefile 1.1%
Other 0.5%
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unknown f547d17650 原脚本太长，将其划分为不同功能模块并进行封装管理 
目前已完成功能设计，但通过全局变量传参，后期需要维护
包络的产生还不够灵活
这里只是扫描线路参数和波形，但还没有支持对不同的采样率进行扫描

Signed-off-by: thfu
 		2025-02-26 15:59:43 +08:00
edf v01-add round module;intp8 and mult_C using round;Modify the directory structure 2024-11-26 13:34:17 +08:00
rtl Á½Â·²¢ÐеÄIIRÂ˲¨Æ÷£¬ÏÂÒ»²½¸ÄÖÁ°Ë·²¢ÐÐ 2025-02-26 15:50:49 +08:00
script_m 原脚本太长，将其划分为不同功能模块并进行封装管理 2025-02-26 15:59:43 +08:00
sim Á½Â·²¢ÐеÄIIRÂ˲¨Æ÷£¬ÏÂÒ»²½¸ÄÖÁ°Ë·²¢ÐÐ 2025-02-26 15:50:49 +08:00
tb Á½Â·²¢ÐеÄIIRÂ˲¨Æ÷£¬ÏÂÒ»²½¸ÄÖÁ°Ë·²¢ÐÐ 2025-02-26 15:50:49 +08:00