 thfu
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6862ad024f
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16路并行，复数乘法器
1.16路62.5M时钟(1G)，用于EZQ2.5验证
2.四指数修正
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2025-04-18 15:19:15 +08:00 |
futh0403
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e297bf11e3
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与基于IP核的分支合并，保留全八路并行的IIR滤波器；
-diff_p.v中的循环展开，并解决vldo悬空的问题；
-锁存调用FF模块，提高代码可读性；
-解决s2p_2.v组合逻辑出现latch的问题；
-解决tb_z_dsp.v没有matlab代码报错的问题
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2025-03-13 15:58:08 +08:00 |
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thfu
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ad5c6434e2
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片上实时产生系数；
增加了z_dsp.sv;
删除了过去插值的相关文件，整理文件夹的结构；
FPGA消耗资源过多，端口使用二维数组；
提高了IIR_Filter_p8.v的可读性，未来需要进一步提高IIR_top.v的可读性，信号的互联是个问题；
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2025-03-11 17:31:24 +08:00 |
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thfu
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8c6c5bb906
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八路并行的IIR滤波器；
未来需要在片上实时生成系数；
需要提高代码可读性
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2025-03-11 16:28:33 +08:00 |