 thfu
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b0e8eaf996
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16路超前计算到1G
1.16路62.5M输入，1G
2.使用实数乘法器
3.四指数修正
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2025-05-14 12:26:24 +08:00 |
futh0403
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6ce1cd456e
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Squashed commit of the following:系数位宽用最优化方式求解
commit 728532bd61
Author: thfu <2779155576@qq.com>
Date: Wed Mar 19 15:17:35 2025 +0800
降低位宽
采用求最优解的方法求解位宽；
不同的系数采用不同的位宽
commit 6e386a2743
Author: futh0403 <futh@mail.ustc.edu.cn>
Date: Thu Mar 13 21:02:23 2025 +0800
合并main分支的部分修改
-尽量避免使用for循环
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2025-03-20 19:34:20 +08:00 |
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thfu
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ad5c6434e2
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片上实时产生系数；
增加了z_dsp.sv;
删除了过去插值的相关文件，整理文件夹的结构；
FPGA消耗资源过多，端口使用二维数组；
提高了IIR_Filter_p8.v的可读性，未来需要进一步提高IIR_top.v的可读性，信号的互联是个问题；
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2025-03-11 17:31:24 +08:00 |
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thfu
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8c6c5bb906
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八路并行的IIR滤波器；
未来需要在片上实时生成系数；
需要提高代码可读性
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2025-03-11 16:28:33 +08:00 |
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unknown
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418cbe0376
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修改z_dsp.m相关函数以批量扫描线路参数和波形
修改TailCorr_Test的名字便于区分Verdi平台用的脚本和Windows平台
Signed-off-by: unknown <2779155576@qq.com>
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2025-03-11 16:28:32 +08:00 |